uart包括哪些模块结构,串口设计模块

 时间:2024-10-27 21:21:39

1、接口部分,中定义一些寄存器,如控制寄存器(control_reg),包括波特率的设置、奇偶校验位设置,bits数目的设置,停止位的设置等;状态寄存器(status_reg)包括奇偶校验错误状态,中断状态,发送接收fifo空满状态,CRC错误状态等;数据寄存器(data_reg)包括发送数据和接收数据。

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2、输出缓存部分,用于缓存待发送的数据,关于它的大小,要根据发送端的吞吐率和uart的速率进行计算,然后给出一个比较合理的值;

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3、输入缓存部分,用于缓存uart_rx接收的的数据,关于它的大小,要根据接收端的吞吐率和uart的速率进行计算,然后给出一个比较合理的值

4、发送状态机部分,用于中取一个字节,然后按照格式{开始位,数据位(位数可变),奇偶校验位,停止位}(有些位可以选择),在uart_baud的控制下一个一个bit的发送出去。

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5、接收状态机,用于接收一个一个bit,然后剥去起始位,奇偶校验位停止位,组成一个字节,然后存入缓存部分。

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